【FPGA】基于vivado的am调制(verilog)

时间:2023-07-12 11:48:01
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文件名称:【FPGA】基于vivado的am调制(verilog)

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更新时间:2023-07-12 11:48:01

FPGA vivado AM调制 verilog

本设计是基于vivado的am调制,指标如下: (1)载波信号频率范围:1M-10MHz,分辨率0.01MHz; (2)调制信号为单频正弦波信号,频率范围:1kHz-10kHz,分辨率0.01kHz; (3)调制深度0-1.0,步进0.1,精度优于5%;


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