数字钟verilog语言实现

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文件名称：数字钟verilog语言实现

文件大小：642KB

文件格式：RAR

更新时间：2013-01-31 11:39:21

数字钟 verilog

这是用verilog语言实现的数字钟，以FPGA为应用平台，实现了精确计时，以及电台报时和闹钟等功能