sha3算法verilog设计及modelsim仿真

时间:2022-08-21 21:41:52
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文件名称:sha3算法verilog设计及modelsim仿真

文件大小:2.28MB

文件格式:RAR

更新时间:2022-08-21 21:41:52

sha3 verilog

在工程中: keccak.v 为顶层文件,分别调用下面几个文件,f_permutation.v、padder1.v、rconst2in1.v、round2in1.v、padder1.v。 test_keccak.v为仿真代码。 在仿真代码test_keccak.v中,仿真控制输入, reg [63:0] in;为输入,wire [511:0] out;为输出端。 在仿真代码中通过对输入的参数进行控制,实现对算法输入控制的变化,通过仿真波形图来观察输出端。 ———————————————— 版权声明:本文为CSDN博主「QQ_778132974」的原创文章,遵循CC 4.0 BY-SA版权协议,转载请附上原文出处链接及本声明。 原文链接:https://blog.csdn.net/QQ_778132974/article/details/124217676


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