文件名称:verilog实现HDB3编码解码modelsim仿真
文件大小:1KB
文件格式:V
更新时间:2022-01-09 09:40:11
verilog modelsim HDB3
verilog实现HDB3编码解码modelsim仿真,大学生EDA大作业,自己做的。。暂且没发现bug,大佬勿喷
文件名称:verilog实现HDB3编码解码modelsim仿真
文件大小:1KB
文件格式:V
更新时间:2022-01-09 09:40:11
verilog modelsim HDB3
verilog实现HDB3编码解码modelsim仿真,大学生EDA大作业,自己做的。。暂且没发现bug,大佬勿喷