数字逻辑实验报告.docx

时间:2023-05-28 10:17:52
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更新时间:2023-05-28 10:17:52

数字逻辑实验

数字逻辑实验,模5七段译码器显示计数,实现预置,D触发器,可在时钟脉冲来一个上升沿的时候,实现计数加一,并使用七段数字译码器显示


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