【文件属性】：
文件名称：基于Verilog的数字钟设计
文件大小：347KB
文件格式：RAR
更新时间：2014-08-04 16:52:00
verilog ,Altera
基于Altera公司的FPGA设计，时分秒可调的数字钟
【文件预览】：
digital_clk
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