riscv-debug:RISC-V调试模块的实现

时间:2024-05-08 17:40:43
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文件名称:riscv-debug:RISC-V调试模块的实现

文件大小:9KB

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更新时间:2024-05-08 17:40:43

Tcl

riscv调试 关于这个项目 RISC-V调试规范的实现(版本1.3) 目标平台 DE10-Lite上的 本项目中使用的调试传输是英特尔FPGA虚拟JTAG riscv-openocd目录包含VJTAG支持


【文件预览】:
riscv-debug-master
----src()
--------dtm.nsl(1KB)
--------vjtag.h(817B)
--------vjtag.v(4KB)
--------dtm.h(870B)
----fpga()
--------Makefile(824B)
--------setup_proj.tcl(24KB)
--------DE10.nsl(715B)
--------DE10.sdc(128B)
--------m(746B)
----LICENSE(1KB)
----.gitmodules(103B)
----README.md(287B)
----riscv-openocd()

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