基于VHDL的数字频率计的设计

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文件名称：基于VHDL的数字频率计的设计

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更新时间：2011-11-29 14:05:50

基于VHDL的数字频率计的设计

不是本人的，是期刊摘录 使用V HDL 语言来设计数字频率计, 给出了原理图和仿真图形, 所设计的电路通过硬件仿真, 下 载到目标器件上运行, 能够满足测量频率的要求, 具有理论与实践意义, 实现了电子电路自动化( EDA) 的过程。 不是本人的，是期刊摘录