CPLD实验报告

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文件名称：CPLD实验报告

文件大小：281KB

文件格式：DOC

更新时间：2018-05-08 17:59:11

cpld FPGA

(1).掌握Verilog HDL模块的基本结构。 (2).掌握计数器的设计方法。 (3).掌握基于Quartus II的CPLD/FPGA开发流程。 (4).实验要求完成模24计数器程序设计，并完成Modelsim仿真