verilog之序列检测

时间:2019-06-09 08:50:50
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文件名称:verilog之序列检测

文件大小:240KB

文件格式:RAR

更新时间:2019-06-09 08:50:50

verilog simulation

verilog之序列检测,vivado工程,使用状态机的方式检测任意长度的数据顺序,提供四个检测工程,并全部带有Testbench,保证你能方便的学会序列检测这个知识点。


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