【文件属性】:
文件名称:altera标准SRD SDRAM控制器参考设计-verilog
文件大小:758KB
文件格式:ZIP
更新时间:2011-10-14 13:18:58
altera SDRAM控制器 verilog
altera标准SRD SDRAM控制器参考设计
【文件预览】:
simulation
----sdr_sdram_tb.v(22KB)
sdr_sdram.pdf
readme_sdr_sdram.txt
source
----PLL1.v(5KB)
----sdr_data_path.v(3KB)
----Params.v(935B)
----Command.v(17KB)
----altclklock.v(8KB)
----sdr_sdram.v(7KB)
----control_interface.v(8KB)
----compile_all.v(206B)
doc
网友评论
- 官方的SDRAM控制器,但不好移植到Xilinx上
- 只是部分,可以作为参考
- 研究中,不够完整
- 对我而言不是特别有用,不过还是有一定帮助的
- 非常好用,不过有些地方要稍微修改修改
- 正在研究,应该还是不错的
- 很有参考价值~~~
- 东西不全,代码还看不了不知道为什么
- 还是有参考价值的
- 代码不全!
- 的确不是很详细,标注也不是很清楚,不过还有一定的参考价值
- 不是很详细,只有部分源码