基于CPLD的倒数计数器 (2007年)

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文件名称：基于CPLD的倒数计数器 (2007年)

文件大小：306KB

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更新时间：2024-05-29 15:40:21

工程技术 论文

用VHDL在CPLD器件上实现一种数字频率计测频系统，能够用十进制数码管显示被测信号的频率及其他多种物理量。整个频率计设计在1块CPLD芯片上，与其他方法做的频率计相比，具有体积小、可靠性高、功耗低的特点。