可校时数字钟

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文件名称：可校时数字钟

文件大小：3.27MB

文件格式：RAR

更新时间：2020-11-04 07:40:34

eda FPGA quartus

设计一个能进行分、秒计时的数字钟，能方便地对分、秒进行手动调节，以校准时间。 数字钟的系统框图如图3-19 所示。设置两位开关量进行模式选择00：计时；01：秒校时； 11：分校时。提示：模式选择通过电平开关SW0 和SW1 实现，手动校时通过KEY0 产生 校时脉冲。 图