【文件属性】：
文件名称：用于FPGA的Verilog-时钟
文件大小：6.92MB
文件格式：ZIP
更新时间：2019-06-20 03:34:29
Verilog-1
用于FPGA的Verilog-时钟
【文件预览】：
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LCD1206（时钟）
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