通用的Verilog HDL 奇数偶数分频器

时间:2014-08-07 04:18:21
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文件名称:通用的Verilog HDL 奇数偶数分频器

文件大小:14KB

文件格式:DOCX

更新时间:2014-08-07 04:18:21

Verilog HDL 奇偶分频器

文中的第一个模块为通用的偶分频模块,第二个模块为通用的奇分频模块,2个模块分频占空比都为1:1,使用时只需将相应模块中parameter DIV_N = N; 中的N改为想要的分频数即可。


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