i2c总线读写模块,使用Verilog编写 时间:2024-02-11 08:50:39 【文件属性】: 文件名称:i2c总线读写模块,使用Verilog编写 文件大小:38KB 文件格式:V 更新时间:2024-02-11 08:50:39 fpga/cpld fpga实现了i2c master的时序,支持单次读写操作者 立即下载