FPGA数字信号处理（四）Quartus FIR IP核实现

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文件名称：FPGA数字信号处理（四）Quartus FIR IP核实现

文件大小：2.36MB

文件格式：7Z

更新时间：2021-06-27 04:19:05

FPGA FIR Quartus IP Verilog

调用Quartus的FIR Compiler IP核完成FIR滤波，含testbench与仿真，仿真结果优秀；具体说明可参考本人博客。CSDN博客搜索：FPGADesigner