MIPS r2000 verilog 源程序

时间:2012-10-02 16:34:29
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更新时间:2012-10-02 16:34:29

MIPS r2000 verilog 源程序 CPU

MIPS r2000 verilog 源程序


【文件预览】:
r2000project_pipeline
----r2000_multiplier.v(7KB)
----r2000_multdiv.v(7KB)
----r2000_pc.v(698B)
----r2000_mux.v(3KB)
----r2000_comparator.v(5KB)
----r2000_regfile.v(944B)
----timescale.v(3KB)
----r2000_pipe_ctrl.v(8KB)
----r2000_divisor.v(8KB)
----r2000_membus.v(11KB)
----r2000_alu.v(2KB)
----define.h(7KB)
----Modified()
--------r2000_pc.v(698B)
--------r2000_mux.v(3KB)
--------r2000_regfile.v(944B)
--------timescale.v(3KB)
--------r2000_alu.v(2KB)
--------r2000_myshifter.v(1KB)
--------r2000_aluctrl.v(1KB)
----r2000_cpu_pipe.v(41KB)
----r2000_myshifter.v(1KB)
----r2000_cp0.v(9KB)
----r2000_decoder.v(12KB)
----r2000_forward.v(6KB)
----r2000_aluctrl.v(1KB)
----Instructions.xlsx(26KB)
----r2000_d-cache.v(17KB)
----r2000_bradecoder.v(6KB)
----r2000_i-cache.v(13KB)
----r2000_pipe.v(4KB)
----Unmodified()
--------Discarded()
--------Easy Ones()
--------Pipeline()
--------r2000_cpu_pipe.v(41KB)
--------Difficult Ones()

网友评论

  • 非常霸气的verilog代码,就是说明不够详细,慢慢研究
  • 非常棒的源程序代码,好好学习