基于vhdl的数字时钟,时间可调

时间:2017-06-06 02:41:25
【文件属性】:

文件名称:基于vhdl的数字时钟,时间可调

文件大小:748KB

文件格式:RAR

更新时间:2017-06-06 02:41:25

FPGA VHDL

用VHDL写的数字时钟 在CYCLONE2上验证通过


【文件预览】:
digitalclock
----digitalclock.asm.rpt(8KB)
----digitalclock.pin(20KB)
----digitalclock.sof(148KB)
----digitalclock.fit.rpt(102KB)
----digitalclock.cdf(330B)
----digitalclock.vhd(9KB)
----db()
--------digitalclock.sta_cmp.8_slow.tdb(33KB)
--------digitalclock.hier_info(6KB)
--------digitalclock.db_info(138B)
--------digitalclock.cmp.logdb(4B)
--------digitalclock.cbx.xml(94B)
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--------digitalclock.asm.rdb(1KB)
--------digitalclock.map.hdb(14KB)
--------digitalclock.rtlv_sg.cdb(12KB)
--------digitalclock.cmp2.ddb(47KB)
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--------digitalclock.cmp.rdb(14KB)
--------logic_util_heursitic.dat(12KB)
--------digitalclock.hif(675B)
--------digitalclock.sta.rdb(21KB)
--------digitalclock.fit.qmsg(23KB)
--------digitalclock.smart_action.txt(8B)
--------digitalclock.eda.qmsg(2KB)
--------digitalclock.sld_design_entry.sci(196B)
--------digitalclock.sgdiff.hdb(11KB)
--------digitalclock.amm.cdb(346B)
--------digitalclock.syn_hier_info(0B)
--------digitalclock.cmp.cdb(38KB)
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--------prev_cmp_digitalclock.qmsg(49KB)
--------digitalclock.rtlv.hdb(11KB)
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--------digitalclock.sgate.rvd(10KB)
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--------digitalclock.asm.qmsg(2KB)
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--------digitalclock.sta.qmsg(16KB)
--------digitalclock.map.cdb(12KB)
--------digitalclock.lpc.txt(1KB)
--------digitalclock.map_bb.logdb(4B)
--------digitalclock.cmp0.ddb(134KB)
--------digitalclock.idb.cdb(5KB)
--------digitalclock.map_bb.cdb(1KB)
--------digitalclock.lpc.html(430B)
--------digitalclock.sgdiff.cdb(12KB)
--------digitalclock.rpp.qmsg(2KB)
--------digitalclock.sld_design_entry_dsc.sci(196B)
--------digitalclock.cmp.hdb(15KB)
--------digitalclock.cmp.bpm(699B)
--------digitalclock.cmp_merge.kpt(211B)
--------digitalclock.(0).cnf.hdb(3KB)
----digitalclock.fit.summary(612B)
----digitalclock.fit.smsg(513B)
----incremental_db()
--------compiled_partitions()
--------README(653B)
----digitalclock.map.rpt(23KB)
----simulation()
--------modelsim()
----digitalclock.pof(512KB)
----digitalclock.map.summary(476B)
----digitalclock.done(26B)
----digitalclock.sta.rpt(188KB)
----digitalclock.qsf(4KB)
----digitalclock.flow.rpt(8KB)
----digitalclock.qpf(1KB)
----digitalclock.sta.summary(2KB)
----digitalclock.eda.rpt(3KB)
----digitalclock.vhd.bak(0B)

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