verilog RTL级代码编写指导(20篇精华文章)

时间:2014-12-29 16:07:31
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文件名称:verilog RTL级代码编写指导(20篇精华文章)

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更新时间:2014-12-29 16:07:31

verilog RTL

verilog RTL级代码编写指导(20篇精华文章)目录: Actel HDL Coding Style Guide; Advanced High-level HDL Design Techniques for Programmable Logic; Designing Safe Verilog State Machines with Synplify; fpga优秀设计的十条戒律; Guide to HDL Coding Styles for Synthesis; IEEE P1364.1_IEEE Standard for Verilog Register Transfer Level Synthesis; IEEE P1364.1D1.4_Draft Standard for Verilog RTL Synthesis; Nonblocking Assignments in Verilog Synthesis, Coding Styles That Kill!; Practical FSM Analysis for Verilog; Re-timing for Performance Improvement in FPGA Designs; RTL Coding Styles That Yield Simulation and Synthesis Mismatches; State Machine Coding Styles for Synthesis; State machine design techniques for Verilog and VHDL; Synthesis and Simulation Design Guide; The Verilog Golden Reference Guide; Verilog Coding Style for Efficient Digital Design ; Verilog HDL Coding(Motorola); Verilog HDL Synthesis A Practical Primer; Xilinx:HDL Coding Style ; 可综合的Verilog语法(剑桥大学,影印)。


网友评论

  • 谢谢分享!!!
  • 很好的RTL及代码编写学习资料!
  • 真实很不错的资源赞一个,就是需要的积分太多了
  • 非常棒的编码指导,感谢分享
  • 很不错的资源
  • 对新手很有帮助,不错
  • 非常棒的编码指导; 学到一定程度一定要规范自己的代码风格,好东西呀
  • 新手很受用!!
  • 对于RTL编码有很大的帮助,谢谢分享!
  • 非常棒的编码指导,都是英文原版,唯一美中不足就是分有点高................
  • 学习coding style必备,包括很多教程,都很不错