文件名称：sdram controller
文件大小：415KB
文件格式：GZ
更新时间：2015-03-06 05:29:33
sdram controller
HSSDRC IP Core is the configurable universal SDRAM controller with adaptive bank control and adaptive command pipeline.
sdram controller
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网友评论
- 这个必须5分，好像是一个MIT的人写的。代码是用system verilog写的，很规范，但是注释较少，需要有一定基础才能看懂。内容上，作者有些贪心，想用一个工程覆盖大多数SDRAM读写的需求；使用者只需要修改很少的参数就能配置成符合自己需求的SDRAM控制器。但是这也造成了工程的代码量较大，难以学习理解。 而且作者还写了很好的testbench，如果你做过SDRAM控制器，恭喜你，这是学习system verilog verification很好的范例。