数字逻辑 课程设计 VHDL 多功能数字钟(1)

时间:2013-01-26 10:09:39
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文件名称:数字逻辑 课程设计 VHDL 多功能数字钟(1)

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更新时间:2013-01-26 10:09:39

数字逻辑 课程设计 VHDL 多功能数字钟

数字逻辑 课程设计 VHDL 多功能数字钟 这个数字钟是我根据我老师的设计自己改编的,内部结构变化挺大的,功能也比较全。 1、具有以二十四小时制计时、显示、整点报时、时间设置和闹钟的功能。 2、设计精度要求为1秒。 (一)计时:正常工作状态下,每日按24h计时制计时并显示,蜂鸣器无声,逢整点报时。 (二)校时:在计时显示状态下,k=1,进入“小时”校准状态,之后按下“k=1”则进入“分”校准状态,继续按下“k=1”则进入“调秒”状态,第三次按下“k键”又恢复到正常计时显示状态。 (1)“小时”校准状态:在“小时”校准状态下,显示“小时”的数码管闪烁,并以1HZ的频率递增计数。 (2)“分”校准状态:在“分”校准状态下,显示“分”的数码管闪烁,并以1HZ的频率递增计数。 (3)“秒”校准状态:在“调秒”状态下,显示“秒”的数码管闪烁,并以1HZ的频率递增计数。 (三)整点报时:蜂鸣器在“59”分钟的第“51”、“53”、“55”、“57”秒发频率为512HZ的低音,在“59”分钟的第“59”秒发频率为1024HZ的高音,结束时为整点。 (四)显示:要求采用扫描显示方式驱动6个LED数码管显示小时、分、秒。 (五)闹钟:闹钟定时时间到,蜂鸣器发出周期为1秒的“滴”、“滴”声,持续时间为60秒;闹钟定时显示。 (六)闹钟定时设置:在闹钟定时显示状态下,按下“k=1”,进入闹钟的“时”设置状态,之后按下“k=1”进入闹钟的“分”设置状态,继续按下“k=1”,又恢复到闹钟定时显示状态。 (1)闹钟“小时”设置状态:在闹钟“小时”设置状态下,显示“小时”的数码管闪烁,并以1HZ的频率递增计数。 (2)闹钟“分”设置状态:在闹钟“分”设置状态下,显示“分”的数码管闪烁,并以1HZ的频率递增计数。


【文件预览】:
数字钟1
----数字逻辑课程设计.doc(273KB)
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--------s60.sof(19KB)
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--------shuzizhong.gdf(9KB)
--------kong.vhd(429B)
--------m60.sof(19KB)
--------decode8.vhd(769B)
--------mux2_1.vhd(334B)
--------showconl.sof(19KB)
--------bridge.sof(19KB)
--------m60.vhd(796B)

网友评论

  • 缺少链接部分
  • 虽然这个代码在我们的课程设计的机子上实现不了,但写得还是不错的
  • 挺好的 ,用到了,不错不错
  • 程序很详细,但是缺少连接部分,我理解起来有点困难..
  • 很好很详细,值得学习!
  • 代码很详细,工程的各个模块的代码写的很清晰,解释说明也很详细。但给的代码好像只有仿真的文件,并没有整体在编译器上编写的文件。因为是刚开始学习这个,很想知道不同模块之间是怎么编写在一起的,但很遗憾没有找到这个源文件。不过总的来说还是很不错的
  • 不错,有水准。值得拥有