Verilog编写的七段数码管显示的源码

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文件名称：Verilog编写的七段数码管显示的源码

文件大小：2KB

文件格式：V

更新时间：2018-01-14 07:31:25

verilog 七段数码管

用Verilog实现FPGA七段数码管的显示。