verilog编写数字钟

时间:2021-01-25 17:37:01
【文件属性】:

文件名称:verilog编写数字钟

文件大小:83KB

文件格式:RAR

更新时间:2021-01-25 17:37:01

数字钟

包含数字钟Verilog代码、multisim仿真图,modelsim仿真图


【文件预览】:
数字钟
----u21.v(364B)
----bcd4.v(807B)
----count_tb.v(420B)
----count.v(1KB)
----bcd5.v(807B)
----u2.v(355B)
----bcd3.v(807B)
----bcd0.v(807B)
----u4.v(354B)
----bcd2.v(807B)
----u14.v(370B)
----捕获3.PNG(24KB)
----bcd1.v(807B)
----u3.v(354B)
----捕获.PNG(27KB)
----原理图.png(37KB)
----u17.v(365B)
----捕获1.PNG(24KB)

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