自己编写的xilix ddr3 IP核用户接口verilog程序

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文件名称：自己编写的xilix ddr3 IP核用户接口verilog程序

文件大小：7KB

文件格式：V

更新时间：2018-05-12 08:02:53

xilinx ise ddr3 verilog

官方给的ddr3测试程序长达万行，有木有很痛苦的感觉？来来来，这个测试接口只有300行左右，实现了顺序写入及顺序读出，可以让你在半个小时之内了解具体的实现方法，本程序在ml605及ise14.4的ddr 3.92上验证过，可以正常读写，但仍然有bug,只是提供一个思路哈，我也在努力继续改进。