电磁1802-吴叶赛-数字钟1

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文件名称：电磁1802-吴叶赛-数字钟1

文件大小：782KB

文件格式：DOCX

更新时间：2022-08-08 18:27:40

二、实验条件内容型号开发环境Vivado2018.1开发语言Verilog HDL开发板NEXYS4 DDR三、实验原理 1）顶层模块 2）七段译码器七段译码器