实验2-寄存器设计1

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文件名称：实验2-寄存器设计1

文件大小：150KB

文件格式：DOCX

更新时间：2022-08-08 17:41:38

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1、实验题目一：8位寄存器设计与实现1.1 实验内容运用Verilog的结构描述法，使用理论课介绍的D触发器完成带有异步清零 clrn 和 同步使能wen的8位