基于VHDL实现数字钟

时间:2011-11-08 04:32:05
【文件属性】:
文件名称:基于VHDL实现数字钟
文件大小:14KB
文件格式:RAR
更新时间:2011-11-08 04:32:05
VHDL 数字钟 FPGA 实现数字钟!!~~~实现数字钟!!~~~实现数字钟!!~~~实现数字钟!!~~~实现数字钟!!~~~实现数字钟!!~~~实现数字钟!!~~~实现数字钟!!~~~
【文件预览】:
clock-pro
----minsecond.vhd(938B)
----display.vhd(741B)
----second.vhd(858B)
----minsecondaa.vhd(866B)
----alert.vhd(887B)
----minsecondb.vhd(1KB)
----minute.vhd(649B)
----hour.vhd(716B)
----fenp.gdf(3KB)
----seltime.vhd(1KB)
----clock02.gdf(8KB)
clock
----clock.gdf(6KB)
----display.vhd(619B)
----second.vhd(679B)
----alert.vhd(607B)
----minute.vhd(649B)
----hour.vhd(525B)
----fenp.gdf(3KB)
----seltime.vhd(936B)

网友评论

  • 可以拿来用用,不过自己还要添加工程才能
  • 实现不了数字钟!!!
  • 没有 完整的源程序 要自己建立工程