文件名称：VHDL基本语法
文件大小：6KB
文件格式：RAR
更新时间：2020-02-25 03:41:28
VHDL
VHDL基本语法
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VHDL基本语法
----元件例化与层次设计.txt(2KB)
----计数器：GENERIC语句的应用.txt(859B)
----条件赋值：使用when else语句.vhd(358B)
----条件赋值：使用多路选择器.vhd(529B)
----加法器：generate语句的应用.txt(1KB)
----将16进制转化为std_logic.txt(809B)
----计数器：wait语句的应用.txt(1014B)
----无符号数到整数的转换.vhd(358B)
----计数器：std_logic_unsigned的用法.txt(922B)
----条件赋值：使用列举类型.vhd(587B)
----计数器：generate语句的应用.txt(1KB)