DSP硬件CCS

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文件格式：PDF

更新时间：2015-11-13 09:16:48

DSP CCS

设计了一种基于 DSP+CPLD 构架的电能质量监测装置，该装置利用 CPLD 产生 DSP 外围器件的控制时序，文中详细介绍 了 CPLD 对 DSP 外围器件的逻辑接口设计，通过 MAX+PLUSⅡ对 CPLD 的控制时序进行仿真，仿真结果验证了本设计的可行性， 试验测试结果表明该装置实现了多项电能质量指标的实时在线监测。