基于CPLD的数字频率计

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文件名称：基于CPLD的数字频率计

文件大小：390KB

文件格式：RAR

更新时间：2013-10-07 10:08:47

VHDL 频率计

基于CPLD，通过编写VHDL语言采用自顶向下设计来实现对频率的测量，其中门闸时间1s。