文件名称:try_adder(verilog程序)
文件大小:3.7MB
文件格式:ZIP
更新时间:2016-01-20 10:15:21
try_adder
自己编织且经验证可以正常运行的程序,用于利用quartusII及modelsim开发,也可用于学习。
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try_adder
自己编织且经验证可以正常运行的程序,用于利用quartusII及modelsim开发,也可用于学习。