用VHDL编写的通信传输模块

时间:2017-03-11 14:30:40
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文件名称:用VHDL编写的通信传输模块

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更新时间:2017-03-11 14:30:40

传输系统

学校课程设计,模拟全套信息传输系统。1M5序列发生器+串并转换2信息码变为汉明再到差分码3汉明并串差分4dpsk生成5信道(加噪)6dpsk解调7dpsk串并差分+纠检错8并串得信息9分频器新建文件夹


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