基于FPGA的数字电子钟设计

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文件名称：基于FPGA的数字电子钟设计
文件大小：668KB
文件格式：PDF
更新时间：2021-04-16 15:58:57
 EDA FPGA QuartusⅡ 数字钟 采用FPGA进行的数字电路设计具有更大的灵活性和通用性，已成为目前数字电路设计的主流方法之一。本文给出一种基于FPGA的数字钟设计方案。该方案采用VHDL设计底层模块，采用电路原理图设计顶层系统。整个系统在QuartusⅡ开发平台上完成设计、编译和仿真，并在FPGA硬件实验箱上进行测试。测试结果表明该设计方案切实可行。