vhdl 计数器的设计

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文件名称：vhdl 计数器的设计

文件大小：28KB

文件格式：DOC

更新时间：2013-01-01 05:00:23

计数器

在数字电路中，是指在时钟脉冲的作用下，组成计数器的各个触发器的状态同时发生变化的一类计数器，即时钟输入时触发器的翻转同时发生的