新FSM_CTRL_AXI4_LITE_SLAVE.zip

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文件名称：新FSM_CTRL_AXI4_LITE_SLAVE.zip

文件大小：4.15MB

文件格式：ZIP

更新时间：2022-07-19 14:51:02

verilog vivado axi4_lite 状态机 testbench

本工程为VIVADO 2017.04版本，先自定义AXI_LITE slave IP，顶层文件调用该IP，通过状态机对该从器件进行读写操作，并编写testbench，观察仿真波形，读写数据一致。