数码管循环显示

时间:2017-02-07 06:22:11
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文件名称:数码管循环显示

文件大小:1.39MB

文件格式:RAR

更新时间:2017-02-07 06:22:11

数码管显示

数码管循环显示程序,verilog程序,fpga开发。


【文件预览】:
work2
----seg.map.summary(460B)
----db()
--------seg.cuda_io_sim_cache.31um_tt_1200mv_85c_slow.hsd(374KB)
--------seg.tiscmp.fast_1200mv_0c.ddb(142KB)
--------seg.pre_map.hdb(10KB)
--------seg.hier_info(1KB)
--------seg.map_bb.cdb(1KB)
--------seg.map.kpt(845B)
--------seg.pre_map.cdb(4KB)
--------seg.map_bb.hdb(8KB)
--------seg.tis_db_list.ddb(238B)
--------seg.tiscmp.slow_1200mv_85c.ddb(142KB)
--------seg.cbx.xml(85B)
--------seg.map.bpm(773B)
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--------seg.cmp.bpm(799B)
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--------seg.cmp.rdb(21KB)
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--------seg.asm.qmsg(2KB)
--------seg.syn_hier_info(0B)
--------seg.amm.cdb(349B)
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--------seg.cmp.logdb(17KB)
--------seg.tiscmp.slow_1200mv_0c.ddb(142KB)
--------seg.hif(1KB)
--------seg.lpc.txt(1KB)
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--------seg.rtlv_sg.cdb(3KB)
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--------seg.map.logdb(4B)
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--------seg.map.hdb(11KB)
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--------seg.sgdiff.hdb(10KB)
--------seg.cmp.kpt(205B)
--------seg.(0).cnf.cdb(4KB)
--------seg.cuda_io_sim_cache.31um_ff_1200mv_0c_fast.hsd(380KB)
--------seg.sta_cmp.6_slow_1200mv_85c.tdb(14KB)
--------seg.sld_design_entry_dsc.sci(212B)
--------seg.cmp.hdb(11KB)
--------seg.map.qmsg(5KB)
--------logic_util_heursitic.dat(6KB)
--------seg.tmw_info(259B)
--------seg.cmp_merge.kpt(210B)
--------prev_cmp_seg.qmsg(43KB)
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--------seg.lpc.html(430B)
----seg.fit.smsg(513B)
----seg.pin(57KB)
----seg.sta.rpt(205KB)
----seg.qpf(1KB)
----seg.fit.summary(607B)
----seg.sta.summary(948B)
----incremental_db()
--------compiled_partitions()
--------README(653B)
----seg_description.txt(0B)
----seg.done(26B)
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----seg.flow.rpt(8KB)
----seg.qsf(4KB)
----seg.asm.rpt(7KB)
----seg.v(2KB)
----seg.fit.rpt(205KB)
----seg.cdf(337B)
----seg.map.rpt(22KB)
----seg.sof(485KB)

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