Verilog-HDL coding style

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文件名称：Verilog-HDL coding style

文件大小：59KB

文件格式：DOC

更新时间：2012-07-29 10:41:32

verilog

Verilog硬件描述语言编码风格 1. 文件头规定 // **************************************************************************** // Copyright (c) 2007, HDU ICCAD // ---------------------------------------------------------------------------- // FILE NAME : prescaler.v // AUTHOR : tommyk // AUTHOR’S EMAIL : tommyk @163.com // DATE : 03/21/2007 // VERVISON : 2.1 // ---------------------------------------------------------------------------- // DESCRIPTION : divide input clock by 16 // ---------------------------------------------------------------------------- // OTHER ISSUES: