spi VERILOG 源码 testbench

时间:2021-09-16 16:34:14
【文件属性】:
文件名称:spi VERILOG 源码 testbench
文件大小:8KB
文件格式:RAR
更新时间:2021-09-16 16:34:14
spi SPI verilog 源码 testbench
【文件预览】:
12spi
----spi()
--------spi_clgen.v(5KB)
--------spi_defines.v(6KB)
--------spi_top.v(12KB)
--------spi_timescale.v(23B)
--------spi_shift.v(9KB)

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