文件名称:黑金 AX309 FPGA uart verilog程序
文件大小:351KB
文件格式:RAR
更新时间:2021-06-27 09:08:18
uart verilog
黑金 AX309 FPGA uart verilog程序,串口收发程序。。。。
【文件预览】:
07_uart_test
----uart_test_map.ngm(178KB)
----uart_test.pcf(830B)
----uart_test.bgn(7KB)
----uart_test_summary.html(17KB)
----uart_test.twr(28KB)
----uart_test.cmd_log(9KB)
----uart_test.prj(150B)
----iseconfig()
--------uartrxtx.xreport(20KB)
--------UART_TEST.projectmgr(8KB)
--------uart_test.xreport(20KB)
--------clkdiv.xreport(20KB)
----uart_test_xst.xrpt(14KB)
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----uart_test.bit(333KB)
----uartrxtx_summary.html(4KB)
----uart_test_par.xrpt(123KB)
----uart_test.ngr(91KB)
----uart_test.ut(552B)
----uart_test.ptwx(16KB)
----uart_test.ngc(62KB)
----uart_test.ngd(96KB)
----clkdiv_summary.html(4KB)
----uart_test.drc(194B)
----uart_test.bld(1KB)
----uart_test.xpi(46B)
----uart_test_map.mrp(9KB)
----usage_statistics_webtalk.html(56KB)
----_xmsgs()
--------bitgen.xmsgs(367B)
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--------ngdbuild.xmsgs(367B)
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--------map.xmsgs(2KB)
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--------xst.xmsgs(7KB)
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----uart_test.par(8KB)
----clkdiv_envsettings.html(15KB)
----xlnx_auto_0_xdb()
--------cst.xbcd(1KB)
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----uart_test.xise(37KB)
----uart_test_summary.xml(409B)
----uart_test.xst(1KB)
----xst()
--------dump.xst()
--------projnav.tmp()
--------work()
----par_usage_statistics.html(4KB)
----uart_test.pad(11KB)
----uart_test.unroutes(301B)
----uart_test.ncd(64KB)
----uarttx_summary.html(4KB)
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--------uart_test.v.bak(341B)
--------testdata.v(2KB)
--------clkdiv.v.bak(644B)
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--------uartrx.v.bak(3KB)
----uart_test_bitgen.xwbt(344B)
----uart_test.twx(46KB)
----webtalk_pn.xml(3KB)
----webtalk.log(773B)
----uartrxtx_envsettings.html(15KB)
----uart_test_ngdbuild.xrpt(8KB)
----uart_test.lso(6B)
----uart_test_pad.txt(51KB)
----uartrxtx.ucf(500B)
----uart_test_map.ncd(37KB)
----uart_test_pad.csv(11KB)
----uart_test.syr(27KB)
----uart_test.stx(0B)
----_ngo()
--------netlist.lst(96B)