高速异步FIFO 的实现

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文件名称：高速异步FIFO 的实现
文件大小：101KB
文件格式：PDF
更新时间：2015-05-11 03:09:53
ic设计基础知识，典型模块设计 采用一种新颖的异步FIFO 设计方案,解决FPGA 多时钟系统中不同时钟域传输数据的问题。该 FIFO 实现方案比传统方式简单,工作速度频率高,如设计采用了Verilog HDL 硬件语言描述还具有良好的移植性