FPGA 多目标连通域识别.zip

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文件名称：FPGA 多目标连通域识别.zip

文件大小：29.04MB

文件格式：ZIP

更新时间：2023-07-12 00:34:17

FPGA Verilog 源码 多目标 连通域

多目标连通域识别，verilog源码识别，附带仿真测试工程，占用2k左右资源，十几行ram缓存，经过测试可以识别出图形中目标，适合在ISE工程中国使用