文件名称：verilog 自动售货机
文件大小：208KB
文件格式：RAR
更新时间：2013-06-18 07:49:56
Verilog 自动售货机 FPGA编程
1）设计一个自动售货机，此机能出售1元、2元、5元、10元的四种商品。出售哪种商品可有顾客按动相应的一个按键即可，并同时用数码管显示出此商品的价格。 2）顾客投入硬币的钱数也是有1元、2元、5元、10元四种，但每次只能投入其中的一种硬币，此操作通过按动相应的一个按键来模拟，并同时用数码管将投币额显示出来。 3）顾客投币后，按一次确认键，如果投币额不足时则报警，报警时间3秒（可用点阵模拟报警）。如果投币额足够时自动送出货物（送出的货物用相应不同的指示灯显示来模拟），同时多余的钱应找回，找回的钱数用数码管显示出来。 4）顾客一旦按动确认键3秒后，自动售货机即可自动恢复到初始状态，此时才允许顾客进行下一次购货操作。 5）售货机还应具有供商家使用的累加卖货额的功能，累加的钱数要用数码管显示，显示2位即可。此累加器只有商家可以控制清零。 6）此售货机要设有一个由商家控制的整体复位控制。
【文件预览】：
happeyending
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----simulation()
--------activehdl()
----seller.map.rpt(102KB)
----disp_goods.v(393B)
----seller.tan.summary(1KB)
----seller.qws(530B)
----seller.eda.rpt(7KB)
----freq.v(574B)
----db()
--------add_sub_5nh.tdf(7KB)
--------seller.db_info(136B)
--------add_sub_k7c.tdf(2KB)
--------add_sub_3ih.tdf(3KB)
--------seller.eco.cdb(160B)
--------add_sub_4ih.tdf(3KB)
--------alt_u_div_cle.tdf(56KB)
--------add_sub_n7c.tdf(2KB)
--------alt_u_div_iie.tdf(9KB)
--------sign_div_unsign_7kh.tdf(2KB)
--------sign_div_unsign_8kh.tdf(2KB)
--------lpm_divide_rvl.tdf(2KB)
--------seller.sld_design_entry.sci(153B)
--------add_sub_j7c.tdf(2KB)
--------sign_div_unsign_klh.tdf(2KB)
--------add_sub_l3c.tdf(2KB)
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--------alt_u_div_kie.tdf(11KB)
--------lpm_divide_svl.tdf(2KB)
--------add_sub_djh.tdf(3KB)
--------lpm_divide_unl.tdf(2KB)
--------lpm_divide_81m.tdf(2KB)
--------add_sub_1ih.tdf(3KB)
--------add_sub_5ih.tdf(3KB)
--------add_sub_m7c.tdf(2KB)
--------add_sub_l7c.tdf(2KB)
----seller.map.smsg(377B)
----seller.map.summary(289B)
----seller.v(1KB)
----disp_m.v(3KB)
----seller.done(26B)
----seller.cdf(284B)
----operate_disp.v(2KB)
----timing()
--------primetime()
----seller.asm.rpt(8KB)
----seller.pof(207KB)
----seller.pin(25KB)
----seller.fit.summary(371B)
----seller.tan.rpt(102KB)
----seller.flow.rpt(5KB)
----count3.v(392B)
----seller.dpf(239B)
----seller.sof(57KB)
----seller.fit.rpt(66KB)
----disp_num.v(3KB)
----seller_assignment_defaults.qdf(37KB)
----seller.qpf(900B)
----sum.v(800B)
----seller.qsf(5KB)
----Out_goods.v(385B)