简单组合逻辑电路设计

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文件名称：简单组合逻辑电路设计

文件大小：272KB

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更新时间：2015-11-01 03:08:58

2位全加器 2位减法器 改进 VHDL

用VHDL实现的简单逻辑电路，包含2位全加器、2位减法器以及其改进后的电路设计

【文件预览】：
简单组合逻辑电路设计
----2位全加器.ms11(98KB)
----2位减法器.ms11(105KB)
----2位减法器改进.ms11(149KB)