VHDL设计多功能数字钟

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文件名称：VHDL设计多功能数字钟

文件大小：622KB

文件格式：DOC

更新时间：2018-01-31 10:24:27

数字逻辑

数字逻辑课程设计报告，实现多功能数字钟的设计，功能：计时,并且可以24小时制和12小时制转换，闹钟，整点报时，秒表。文档内包含代码，硬件连线图，仿真波形图，心得体会等。