· Load/Store Instructions
The ARM is a Load/Store Architecture: Does not support memory to memory data processing operations. Must move data values into registers before using them.ARM has three sets of instructions which interact with main memory. These are
Single register data transfer(LDR/STR)
Block dtat transfer(LDM/STM)
Single Data Swap(SWP)
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指令
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描述
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LDR
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字资料载入指令
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LDRB
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字节资料载入指令
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LDRH
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半字资料载入指令
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STR
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字资料存储指令
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STRB
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字节资料存储指令
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STRH
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半字资料存储指令
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Syntax：
<LDR|STR>{<cond>}{<sizez>} Rd,<address>
· Load and Store Word or Byte，offset from the base register
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指令
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说明
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LDR R0,[R1]
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将地址
R1
处字资料读入
R0
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LDR R0, [R1, R2]
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将地址
R1+R2
处字资料读入
R0
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LDR R0,[R1, #8]
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将地址
R1+8
处字资料读入
R0
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LDR R0, [R1, R2]!
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将地址
R1+R2
处字资料读入
R0,
并将新地址
R1+R2
写入
R1
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LDR R0, [R1, #8]!
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将地址
R1+8
处字资料读入
R0,
并将新地址
R1+8
写入
R1
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LDR R0, [R1], R2
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将地址
R1
的字资料读入
R0,
并将新地址
R1+R2
写入
R1
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LDR R0, [R1, R2,LSL #2]!
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将地址
R1+R2x4
处字资料读入
R0,
新址
R1+R2x4
写入
R1
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LDR R0,[R1],R2,LSL #2
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将地址
R1
处字资料写入
R0,
新址
R1+R2x4
写入
R1
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STR r0,[r1,#-12]
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将
r0
写入到地址
r1-12
处
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Example：Write a segment of code that add together elements x to x+(n-1) of an array, where the element x = 0 is the first element of the array. Each element of the array is word size(ie, 32bits). The segment should use post-indexed addressing.At the start of your segments, you should assume that: r0 points to the start of the array, r1 = x, r2 = n;
Sample Solution:
DataSpace SPACE 100; 连续分配100个字节的存储单元并初始化为0
ADD r0, r0, r1, LSL#2
ADD r2, r0, r2, LSL#2
MOV r1, #0
loop
LDR r3, [r0],#4
ADD r1, r1, r3
CMP r0, r3
BLT loop
· Block Data Transfer
The Load and Store Multiple instruction(LDM/STM) allow between 1 and 16 registers to be transferred to or from memory.
格式：
LDM(STM){条件}{类型}基址寄存器{!}，寄存器列表{^}
该指令常见用途是将多个寄存器的内容入栈或出栈。类型包括非堆栈型寻址或堆栈型寻址。
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寻址
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说明
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IA Increment After
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基址寄存器在取后才增加
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IB Increment Before
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基址寄存器在取前才增加
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DA Decrement After
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基址寄存器在存取后才减少
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DB Decrement Before
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基址寄存器在存取前即减少
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FD Full Descending
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满递减
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FA Full Ascending
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满递增
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ED Empty Descending
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空递减
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EA Empty Ascending
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空递增
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Traditionaly, a stack grows down in memory, with the last ‘pushed’ value at the lowest address. The ARM also supports ascending stacks, where the stack structure grows up through memory. The value of the stack pointer can either:
Point to the last occupied address(Full stack)—and so needs pre-decrementing(ie before the push). Point to the next occupied address(Empty stack)—and so needs post-decrementing(ie after the push)
注意，象
STMFD, STMED
，
STMFA
和
STMEA
分别跟
LDMFD, LDMED, LDMFA
和
LDMEA
配对，故理解不能全部按照字面意思来。
· 资料交换指令
语法
SWP{<cond>}{B} Rd, Rm, [Rn]
SWP{条件}{B} 目的寄存器，来源寄存器1，[来源寄存器2]
SWP指令用于将来源寄存器2所指向的存储器中的字资料般移到目的寄存器，同时将来源寄存器1的字资料般移到来源寄存器2所指向的存储器中。当来源寄存器1和目的寄存器为同一存储器时，该指令交换该寄存器和存储器的内容
SWP R0, R1, [R2] ;将R2所指向的存储器中的字般移到R0，同时将R1中的字资料般移到R2指向的存储单元
SWP R0, R0, [R1] ;该指令完成将R1所指向的存储体中的字资料与R0中的字资料交换
SWPB R0, R1, [R2] ;
將
R2
所指向的記憶體中的位元組資料般移到
R0
，
R0
的高
24
位清零，同時將
R1
中的低
8
位元資料般移到
R2
所指向的存儲單元
SWPB R0, R0, [R1] ;
該指令完成將
R1
所指向的記憶體中的位元組資料與
R0
中的低
8
位元資料交換
· PSR Transfer Instructions
MRS and MSR allow contents of CPSR/SPSR to be transferred from appropriate status register to a general purpose register.
MRS{<cond>} Rd, <psr>
MSR{<cond>} <psr>, Rm
MSR{<cond>} <psrf>, Rm
<psr> = CPSR, CPSR_all, SPSR or SPSR_all
<psrf> = CPSR_flg or SPSR_flg
MSR{<cond>} <psrf>, #Immediate
其中Immediate为32位立即数，最高4位写入到flag bits.
有时LDR r0, =DataSpace和ADR r0,DataSpace效果一样
伪指令DCD分配一片连续的字存储单元并初始化，例如
string1 DCD 0x23, 0x24
string2 DCD 0x23, 0x25
类中定义的
static
变量和函数定义的
static
变量，全局变量一样，都是通过
startup
函数调用库定义的
?main
函数来实现其初始化的。