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*****作者：黄仁军 *******
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快要毕业了，毕业之前再重新把这些实验从头到尾的练习一遍，先开始裸机的吧，这些都是以前搞过的东西，现在应该会比较快。。
开始吧！
时钟对于电子设备来说都是非常重要的，它是传输数据的一个基准，如果没有这个基准的话将导致系统的混乱。
S3C2440的频率有两种输入方式：外部时钟源和内部晶振（如下图）
输入的频率一般是比较低的比如2440的就只有12M，而2440的主频可以达到460M，这就需要对输入频率通过PLL锁相环进行倍频
先来看下这个CLOCK的结果图：
从上面的结果图可以看出输入频率OSC首先经过MPLL倍频
整个系统时钟主要有几个组成：FCLK,HCLK,PCLK
FCLK:是个cpu提供时钟
HCLK：用于AHB总线，中断控制器，LCD控制器，内存控制器提供时钟
PCLK：用于APB总线，通常给IIC,WDT,IIS,ADC, UART, GPIO, RTC and SPI.等外设提供时钟
下面是整个时钟系统的几种工作方式：正常，空闲，慢，睡眠模式。
慢模式：也就是没有通过MPLL倍频，直接就由外部时钟源或者内部晶振来提供时钟，所以系统的功耗有时钟源来决定
设置系统时钟主要配置几个寄存器：
MPLLCON：设置P,S,M的值
CLKDIVN：设置FCLK,HCLK,PCLK的比例关系
MPLL和UPLL的计算公式不同：
Mpll = (2*m * Fin) / (p * 2s)
m = M (the value for divider M)+ 8, p = P (the value for divider P) + 2，s = SDIV
UPLL Control Register
Upll = (m * Fin) / (p * 2S)
m = (MDIV + 8), p = (PDIV + 2), s = SDIV
另外需要特别注意的一点，如果直接采用上面的式子计算输出频率很可能出错，因为会发生溢出，故采用下面的式子：
FOUT = 2 * m * （Fin/100） / (p*2S)×100,
下面是核心代码：